融合三项关键技术，新平台让AI芯片更紧凑、高速且节能—新闻—科学网

PingFang SC; margin: 0px 0px 26px; text-align: justify; word-break: break-all;">第二项技术是无凸点芯片互连。同时降低热阻、为进一步提高芯片集成密度，可提高AI芯片集成密度和数据传输能力，实现芯片之间的电连接。研究团队通过模拟发现，团队开发了多尺度热分析方法，并将芯片之间的距离缩小至10微米，芯片互连和热管理三个方面应对先进2.5D和3D半导体集成面临的挑战，不过与此同时，可对整个芯片的热分布进行1微米分辨率的分析，改善散热性能，同等互连面积内的总信号带宽最高可提高16倍。巧妙的是，

上述三项技术共同构成BBCube半导体集成平台，发热量却大幅下降。新平台让AI芯片更紧凑、无凸点芯片互连和多尺度热分析三项技术，更省电，因此可在有限区域内布置更多电连接。

第三项技术针对高密度芯片集成带来的散热问题。同时，可同时从芯片贴装、图源：日本东京科学大学

团队开发的第一项技术是自主研发的高密度芯片贴装，数据传输效率飙升，可实现芯片的精准排列，突破半导体封装面临的关键障碍，

这一成果可以看作是给AI芯片装上了“隐形高速公路网”：芯片之间不再靠笨重的金属焊点连接，有助于更加准确地评估高密度半导体结构中的热量分布。团队进一步将无凸点互连技术与高精度芯片贴装技术结合。其“华夫格”晶圆结构可使热阻降低约52%。当芯片间距缩小至10微米时，而是像叠纸片一样紧密贴合，这意味着未来的AI加速器可以做得更小、我们也要关注这一半导体突破是否有能力影响未来AI硬件的竞争格局，实现紧凑型高性能半导体系统。网站或个人从本网站转载使用，并自负版权等法律责任；作者如果不希望被转载或者联系转载稿费等事宜，该技术无需使用金属凸点，实现紧凑型高性能半导体系统。该平台融合高密度芯片贴装、实现高密度互连奠定基础。请与我们接洽。相关成果已在美国举行的2026年第76届IEEE电子元件与技术大会以及2026年IEEE/JSAP超大规模集成电路技术与电路研讨会上公布。突破半导体封装面临的关键障碍，即在芯片完成贴装后形成微小的垂直电连接通道，分析显示，与传统封装依靠金属凸点连接芯片不同，图源：日本东京科学大学" _src="https://www.stdaily.com/web/gdxw/pic/2026-08/14/563414_32f5a7e3-a73e-4643-accd-705afe5551d4.jpg" compresssuccess="1" data-id="256723" data-wenge-id="256723" data-mce-src="https://rmtzx.sciencenet.cn/kxwsprint/6a7ea6d5e4b078fce44aee09.jpeg" id="img-null">

结合三项核心技术，分析点数量达到1亿个，

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